一：

8位計(jì)數(shù)器技術(shù)百科

問題1：設(shè)計(jì)一個(gè)8位減法計(jì)數(shù)器電路(7,6…0循環(huán))用D觸發(fā)器實(shí)現(xiàn)
答：D觸發(fā)器可以做二進(jìn)制的減法計(jì)數(shù)器,第二級(jí)的d觸發(fā)器cp端接到第一級(jí)的q端就可以了但是d觸發(fā)器得連接成t’觸發(fā)器。

問題2：verilog設(shè)計(jì)可預(yù)置8位計(jì)數(shù)器
8位計(jì)數(shù)器答：你犯了一個(gè)小小的錯(cuò)誤：對(duì)于reg類型的變量，只能在一個(gè)always里面賦值，比如R和P。對(duì)于仿真來說，一個(gè)reg在兩個(gè)always里面賦值是沒問題的，但是不能綜合，quartus里面如果選擇編譯綜合布局布線一步走的話就會(huì)報(bào)錯(cuò)。對(duì)于這種。

問題3：多功能8位十進(jìn)制數(shù)字頻率計(jì)數(shù)器的設(shè)計(jì)
8位計(jì)數(shù)器答：電子工程師經(jīng)常需要測(cè)量頻率、時(shí)間間隔、相位和對(duì)事件計(jì)數(shù)，精確的測(cè)量離不開頻率計(jì)數(shù)器或它的同類產(chǎn)品，如電子計(jì)數(shù)器和時(shí)間間隔分析儀。這些儀器為研發(fā)提供高精度和分析能力，為大批量生產(chǎn)提供高效率并為維修提供低成本和便攜。

問題4：急求:VerilogHDL的8位或者16位計(jì)數(shù)器
答：modulecounter_8(out,clk,rst);inputclk,rst;output[7:0]out;reg[7:0]out;always@(posedgeclk)beginif(!rst)beginout<=8'b00000000;endelseout<=out+1;endendmodule以上是8位計(jì)數(shù)器，16位。

問題5：八位機(jī)是什么意思
8位計(jì)數(shù)器答：八位機(jī)是指八位單片機(jī)。單片機(jī)的發(fā)展先后經(jīng)歷了4位、8位、16位和32位等階段。8位單片機(jī)由于功能強(qiáng)，被廣泛用于工業(yè)控制、智能接口、儀器儀表等各個(gè)領(lǐng)域；八位單片機(jī)是在中、小規(guī)模應(yīng)用場(chǎng)合仍占主流地位，代表了單片機(jī)的發(fā)展。

問題6：verilog8位計(jì)數(shù)器
8位計(jì)數(shù)器答：回答：將clk=0;去掉。

問題7：用multisim實(shí)現(xiàn)8位可逆循環(huán)計(jì)數(shù)器
答：如圖所示。

問題8：如何用2塊74LS161做成8位計(jì)算器?
8位計(jì)數(shù)器答：出現(xiàn)了什么錯(cuò)誤？請(qǐng)把555與計(jì)數(shù)器的電路圖貼出來吧，這樣好分析些74ls161是16進(jìn)制計(jì)數(shù)器。0000-1111一個(gè)脈沖走一個(gè)數(shù)。74ls38是38線譯碼器。有3個(gè)輸入端。將74ls161低三位輸出端聯(lián)在74ls138上。74ls138有8個(gè)輸出端。

問題9：Verilog程序設(shè)計(jì),怎么實(shí)現(xiàn)模塊調(diào)用,構(gòu)成8位的計(jì)數(shù)器?
答：moduleCounter(clk,rst,counter);inputclk;inputrst;outputcounter;reg[7:0]counter;always@(posedgeclk,posedgerst)beginif(rst)begincounter<='b0;endelsebegincounter<=counter+1'b1。

問題10：用74LS161設(shè)計(jì)8進(jìn)制計(jì)數(shù)器。(要求有詳細(xì)設(shè)計(jì)過程并畫出電路圖)_百度知
答：使用反饋預(yù)置法設(shè)計(jì)8進(jìn)制計(jì)數(shù)器，8的二進(jìn)制為1000，即Q2Q1Q0都為000，Q3為1，因此將Q3通過一個(gè)非門接入置位端，這樣每次計(jì)數(shù)到7后被置為0，完成0-7的8進(jìn)制計(jì)數(shù)。置數(shù)端D3D2D1D0設(shè)置為0。

二：

8位計(jì)數(shù)器技術(shù)資料

問題1：?jiǎn)纹瑱C(jī)定時(shí)器t0的低八位計(jì)數(shù)器是哪一個(gè)
8位計(jì)數(shù)器答：51單片機(jī)定時(shí)器Timer0的計(jì)數(shù)器低八位寄存器是TL0。

問題2：求單品機(jī)報(bào)告關(guān)于8位計(jì)數(shù)器任務(wù):設(shè)計(jì)并實(shí)現(xiàn)8位計(jì)數(shù)器(主控器件采用MCU
8位計(jì)數(shù)器答：確實(shí)很簡(jiǎn)單。我可以給你寫程序，你把外圍電路告訴我吧。比如，用的哪些腳控制數(shù)碼管（一般都用鎖存器了）。

問題3：8位定時(shí)/計(jì)數(shù)器時(shí)鐘頻率1MHZ其最大定時(shí)時(shí)間是多少
答：1、如果是單指令周期,而且沒有分頻前提,那么每個(gè)指令周期:1/1MHz=1uS,最大定時(shí)間(2^8-0)×1uS=256uS。2、計(jì)數(shù)是一種最簡(jiǎn)單基本的運(yùn)算,計(jì)數(shù)器就是實(shí)現(xiàn)這種運(yùn)算的邏輯電路,計(jì)數(shù)器在數(shù)字系統(tǒng)中主要是對(duì)脈沖的個(gè)數(shù)進(jìn)行計(jì)數(shù)。

問題4：設(shè)計(jì)一個(gè)8位減法計(jì)數(shù)器電路(7,6…0循環(huán))用D觸發(fā)器實(shí)現(xiàn)
8位計(jì)數(shù)器答：D觸發(fā)器可以做二進(jìn)制的減法計(jì)數(shù)器，第二級(jí)的d觸發(fā)器cp端接到第一級(jí)的q端就可以了但是d觸發(fā)器得連接成t’觸發(fā)器。

問題5：請(qǐng)問如何用vhdl編寫8位程序計(jì)數(shù)器PC
答：1、運(yùn)行VS2010主程序。2、第一次啟動(dòng)時(shí)需要進(jìn)行開發(fā)程序設(shè)置。3、等待幾分鐘，等待構(gòu)建編程環(huán)境。4、選擇窗口應(yīng)用程序，然后點(diǎn)擊確定。5、添加一按鈕控件，把他的text屬性設(shè)置為helloworld。6、雙擊按鈕，寫入如下代碼。msg。

問題6：請(qǐng)說下定時(shí)計(jì)數(shù)器4種工作方式的特點(diǎn)以及實(shí)用場(chǎng)合
答：特殊工作方式只適用于T0，除了是用8位寄存器TL0外，其功能和操作與方式0和方式1完全相同，可作定時(shí)器使用，也可用作計(jì)數(shù)器。但是，另一個(gè)計(jì)數(shù)器TH0只可以工作在內(nèi)部定時(shí)器模式下。工作方式3為T0增加了一個(gè)8位的定時(shí)器。

問題7：用verilog8位計(jì)數(shù)器實(shí)現(xiàn)清零,加減,置位
8位計(jì)數(shù)器答：always@(posedgeclkorposedgerst)if(rst)out8<=0;elseif(set)out8<=8'b10101010;elsecase(sel)1:if(out8==8'hff)out8<=0;elseout8<=out8+1;0:if(out8==0)out8<=8'hff;elseout8<=out8。

問題8：?jiǎn)纹瑱C(jī)定時(shí)器T0和T1有什么區(qū)別呀?求助~~~
答：?jiǎn)纹瑱C(jī)定時(shí)器T0和T1的區(qū)別：1、工作方式選擇的不同。定時(shí)器T1沒有方式3，方式3只適合定時(shí)器T0，使其增加一個(gè)8位定時(shí)器。若定時(shí)器T1選擇方式3，T1將停止工作，相當(dāng)于TR1=0的情況。2、工作方式控制位的不同。在工作方式。

問題9：74161如何構(gòu)成八進(jìn)制的計(jì)數(shù)器???
答：第一級(jí)的4個(gè)輸出端（Q3,Q2,Q1,Q0）就是8,4,2,1。這個(gè)第一級(jí)的計(jì)數(shù)輸入是從CLK端輸入的，第二級(jí)的CLK接第一級(jí)的Q3,就構(gòu)成了八進(jìn)制計(jì)數(shù)器的第二級(jí)。如此類推，就構(gòu)成了多位的八進(jìn)制計(jì)數(shù)器電路。

問題10：verilog代碼我寫了一個(gè)8位計(jì)數(shù)器和它的testBench但仿真時(shí)輸出沒反應(yīng)是
8位計(jì)數(shù)器答：你現(xiàn)在的代碼，計(jì)數(shù)的是ena信號(hào)高電平的次數(shù)。

三 ：

8位計(jì)數(shù)器名企推薦

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